西迪斯對于超小型無源晶體有著獨(dú)特的見解,并提供高效的解決方案416F380XXASR，高速電流轉(zhuǎn)向邏輯[HCSL]輸出是外設(shè)組件互連快速[PCIe]應(yīng)用，英特爾和英偉達(dá)芯片組之間別人。HCSL是差動輸出標(biāo)準(zhǔn)，類似到LVPECL，提供高阻抗輸出快速切換時間。其他優(yōu)勢包括與LVDS輸出晶振和相比的平均功耗LVPECL和低相位抖動性能。

差動輸出有一個15mA的電流源來自一個開放的發(fā)射器或源，有不終止的漏極，需要外部50歐姆電阻端到地。如果需要，10到30歐姆的系列可增加電阻以減少超調(diào)或振鈴波形.

416F3841XCDR	CTS晶振	416	MHz Crystal	38.4MHz
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PCIe是由PCI特殊興趣組(PCI SIG)開發(fā)的串行點(diǎn)對點(diǎn)互連標(biāo)準(zhǔn)，最初用于幫助電腦制造商實(shí)施英特爾規(guī)范。然而，由于它的低成本和高數(shù)據(jù)吞吐量，PCIe已經(jīng)在多個應(yīng)用標(biāo)準(zhǔn)中采用包括刀片服務(wù)器、數(shù)據(jù)存儲[SATAe & M.2]，嵌入式計(jì)算，3D圖形、網(wǎng)絡(luò)[千兆以太和和通信平臺。在考慮到它的普及、簡單和可擴(kuò)展性;PCIe電接口主要應(yīng)用于asic、fpga和soc。這為設(shè)計(jì)師提供靈活的解決方案用于系統(tǒng)中的高速數(shù)據(jù)傳輸。

416F384X3ASR	CTS晶振	416	MHz Crystal	38.4MHz
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PCIe的基本架構(gòu)是由兩個設(shè)備之間的數(shù)據(jù)鏈路組成，可以有1 ~ 32個通道。PCIe鏈路分為x1、x2、x4、x8、x12、x16和x32。每條車道由差動導(dǎo)線對，一對用于發(fā)送[Tx]，另一對用于接收[Rx]數(shù)據(jù)。一個單車道將以每周期1位的速率傳輸數(shù)據(jù)，因此增加更多的車道將增加傳輸速率。

美國CTS晶振公司研發(fā)發(fā)現(xiàn)需要一個外部參考時鐘來傳輸數(shù)據(jù)。標(biāo)準(zhǔn)時鐘要求包括頻率100MHz，最大穩(wěn)定性±300ppm和HCSL輸出。雖然從PCIe1.0到PCIe4.0，參考時鐘頻率對所有PCIe一代保持相同，抖動要求得到了改進(jìn)，以支持后續(xù)版本中更高的傳輸速率。表1概述了PCIe時鐘抖動的歷史要求，以及突出顯示將于2019年開發(fā)的新Gen5.0標(biāo)準(zhǔn)。

416F40013CKR	CTS晶振	416	MHz Crystal	40MHz
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416F40023CAR	CTS晶振	416	MHz Crystal	40MHz
416F40023CDR	CTS晶振	416	MHz Crystal	40MHz
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416F40033CTR	CTS晶振	416	MHz Crystal	40MHz
416F40035AAR	CTS晶振	416	MHz Crystal	40MHz
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416F40035AKR	CTS晶振	416	MHz Crystal	40MHz
416F40035ALR	CTS晶振	416	MHz Crystal	40MHz
416F40035ASR	CTS晶振	416	MHz Crystal	40MHz
416F40035ATR	CTS晶振	416	MHz Crystal	40MHz
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416F40035CTR	CTS晶振	416	MHz Crystal	40MHz
416F400X2AAR	CTS晶振	416	MHz Crystal	40MHz
416F400X2ADR	CTS晶振	416	MHz Crystal	40MHz

參考時鐘的抖動直接影響設(shè)備間數(shù)據(jù)傳輸?shù)男?。改善在抖動性能幫助消除延遲的數(shù)據(jù)傳輸和客戶有兩種產(chǎn)生時鐘信號的選擇用于PCIe數(shù)據(jù)傳輸。

1]一個100MHz的HCSL輸出時鐘振蕩器和一個緩沖器產(chǎn)生多個時鐘信號。

2]一個25MHz的晶體和一個PLL，該P(yáng)LL乘以基準(zhǔn)產(chǎn)生100MHz的時鐘信號。CTS解決方案提供了一個低抖動的時鐘振蕩器需要上面的第1項(xiàng)。

416F400X2AKR	CTS晶振	416	MHz Crystal	40MHz
416F400X2ALR	CTS晶振	416	MHz Crystal	40MHz
416F400X2ASR	CTS晶振	416	MHz Crystal	40MHz
416F400X2ATR	CTS晶振	416	MHz Crystal	40MHz
416F400X2CAR	CTS晶振	416	MHz Crystal	40MHz
416F400X2CDR	CTS晶振	416	MHz Crystal	40MHz
416F400X2CKR	CTS晶振	416	MHz Crystal	40MHz
416F400X2CLR	CTS晶振	416	MHz Crystal	40MHz
416F400X2CSR	CTS晶振	416	MHz Crystal	40MHz
416F400X2CTR	CTS晶振	416	MHz Crystal	40MHz
416F400X3AAR	CTS晶振	416	MHz Crystal	40MHz
416F400X3ADR	CTS晶振	416	MHz Crystal	40MHz
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416F400X3ASR	CTS晶振	416	MHz Crystal	40MHz
416F400X3ATR	CTS晶振	416	MHz Crystal	40MHz
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416F400XXCSR	CTS晶振	416	MHz Crystal	40MHz
416F400XXCTR	CTS晶振	416	MHz Crystal	40MHz
416F40611AAR	CTS晶振	416	MHz Crystal	40.61MHz
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416F40613AAR	CTS晶振	416	MHz Crystal	40.61MHz

PCIe標(biāo)準(zhǔn)是一項(xiàng)核心技術(shù)，用于在多個應(yīng)用標(biāo)準(zhǔn)中互連外圍設(shè)備。隨著PCIe 5.0的開發(fā)，它將使400GE的大規(guī)模采用技術(shù)，因?yàn)樗娜p工帶寬約128GB/s的16車道系統(tǒng)。這將成為下一代關(guān)鍵技術(shù)所需的支持響應(yīng)時間和高5G和物聯(lián)網(wǎng)的帶寬要求。